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基于AD7543和FPGA的數(shù)／模轉(zhuǎn)換電路設(shè)計(jì)
設(shè)計(jì)基于AD7543和FPGA的數(shù)／模轉(zhuǎn)換電路，介紹AD7543的主要特點(diǎn)、封裝形式、引腳功能和工作原理，設(shè)計(jì)基于AD7543轉(zhuǎn)換芯片的具體的數(shù)／模轉(zhuǎn)換硬件電路，利用Verilog HDL語言描述AD7543的控制時(shí)序，并給出具體的Veril-og HDL代碼及其仿真結(jié)果。實(shí)踐結(jié)果表明，該設(shè)計(jì)可行，可取代傳統(tǒng)的“CPU+專用的數(shù)／模轉(zhuǎn)換(D／A)芯片”設(shè)計(jì)結(jié)構(gòu)，可進(jìn)一步提高系統(tǒng)的可靠性和抗干擾能力。
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基于Sunplus SPCE061A控制核心的電動(dòng)車蹺蹺板設(shè)計(jì)及實(shí)現(xiàn)
在多次全國電子設(shè)計(jì)大賽中，電動(dòng)車的設(shè)計(jì)一直都是熱點(diǎn)，從歷屆的電動(dòng)車設(shè)計(jì)作品來看，電動(dòng)車的車體往往做得大而重，且常常需要依靠車體以外的模塊輔助才能完成，這對于車來說就不夠智能化了。本文中電動(dòng)車設(shè)計(jì)
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寬范圍高穩(wěn)晶振頻率穩(wěn)定度測試系統(tǒng)的設(shè)計(jì)
0 引 言 高穩(wěn)定度石英晶體諧振器(簡稱高穩(wěn)晶振)是廣泛應(yīng)用于通訊、電子對抗、數(shù)傳電臺(tái)、計(jì)算機(jī)等電子信息產(chǎn)品的重要器件。高穩(wěn)晶振的指標(biāo)直接影響產(chǎn)品的可靠性，因此如何檢測其性能是非常重要的。 代表性
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FIR帶通濾波器的FPGA實(shí)現(xiàn)
為設(shè)計(jì)一個(gè)項(xiàng)目可用的FIR數(shù)字帶通濾波器，采用Matlab／Simulink軟件中DSPBulider強(qiáng)大的算法模塊設(shè)計(jì)工具，結(jié)合Altera公司的FPGA開發(fā)板實(shí)現(xiàn)FIR數(shù)字帶通濾波器的系統(tǒng)集成、RTL級(jí)仿真、綜合編譯、下載等設(shè)計(jì)流程，并對正弦信號(hào)進(jìn)行濾波，結(jié)果下載到開發(fā)板上用示波器觀測，達(dá)到了預(yù)期的濾波效果和目的?；贒SPBuilder完成系統(tǒng)建模，省去了復(fù)雜的VHDL編程，還可針對具體模塊進(jìn)行參數(shù)設(shè)置從而適應(yīng)不同的濾波需求。該方法實(shí)現(xiàn)簡單、可靠，還可類推實(shí)現(xiàn)其他復(fù)雜的嵌入式系統(tǒng)設(shè)計(jì)。
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基于OTDR技術(shù)的光纖測試方法探討
光纖通信是以光波作載波以光纖為傳輸媒介的通信方式。光纖通信由于傳輸距離遠(yuǎn)、信息容量大且通信質(zhì)量高等特點(diǎn)而成為當(dāng)今信息傳輸?shù)闹饕侄?，是“信息高速公路”的基石。光纖測試技術(shù)是光纖應(yīng)用領(lǐng)域中最廣泛、
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基于多速率DA的根升余弦濾波器的FPGA實(shí)現(xiàn)
0 引 言 根升余弦成形濾波器是數(shù)字信號(hào)處理中的重要部件，它能對數(shù)字信號(hào)進(jìn)行成形濾波，壓縮旁瓣，減少干擾的影響，從而降低誤碼率。根據(jù)文獻(xiàn)[1]，它的傳統(tǒng)FP-GA實(shí)現(xiàn)方式基于乘累加器(Multiplier Add Cell，M
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高阻抗表面型PBG結(jié)構(gòu)貼片天線的設(shè)計(jì)
由于微帶貼片天線具有體積小、重量輕、低剖面、易加工、共形等優(yōu)點(diǎn)，所以在軍事和民用方面都有著廣泛的應(yīng)用前景。眾所周知，集成電路的基底是一些高介電常數(shù)材料，而微帶貼片天線在低介電常數(shù)基底上才能獲得最
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一種新的混合預(yù)失真器的設(shè)計(jì)
0 引 言 現(xiàn)代無線通信的迅猛發(fā)展日益朝著增大信息容量，提高信道的頻譜利用率以及提高線性度的方向發(fā)展。一方面，人們廣泛采用工作于甲乙類狀態(tài)的大功率微波晶體管來提高傳輸功率和利用效率；另一方面，無源器
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基于FPGA嵌入式的多比特自相關(guān)器設(shè)計(jì)
該設(shè)計(jì)利用FPGA的嵌入式軟核NiosⅡ處理器，通過嵌入式操作系統(tǒng)μC／OS-Ⅱ，實(shí)現(xiàn)了在FPGA內(nèi)的自相關(guān)計(jì)算器；利用FPGA強(qiáng)大的并行運(yùn)算功能和自帶存儲(chǔ)器實(shí)現(xiàn)的“乒乓”RAM，通過軟核NiosⅡ輸出控制字實(shí)時(shí)切換調(diào)用兩個(gè)“乒乓”RAM的存儲(chǔ)和讀取功能，使之同時(shí)完成對采集數(shù)據(jù)的緩沖存儲(chǔ)和向乘法器提供計(jì)算數(shù)據(jù)的功能，使芯片的整個(gè)數(shù)字處理鏈路連續(xù)化。另外，采用多比特進(jìn)行自相關(guān)運(yùn)算較之于現(xiàn)在天文臺(tái)使用的1 b量化自相關(guān)器，能有效地提高SNR退化比。
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基于FPGA的PC／104-CAN通訊板設(shè)計(jì)
0 引 言 PC／104嵌入式控制PC出現(xiàn)于20世紀(jì)80年代末，并于1992年形成IEEEP966．1標(biāo)準(zhǔn)。它一方面繼承了PC的所有資源，另一方面又對PC的各個(gè)方面做了優(yōu)化設(shè)計(jì)，使其與IBM PC完全兼容，并具有體積小，功耗低，工作
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