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一種基于鐵電存儲器的雙機串行通信技術
分析不同種類單片機之間通信的方式及難點，提出一種基鐵電存儲器的解決方案與實例。
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使用PLD內(nèi)部鎖相環(huán)解決系統(tǒng)設計難題
從整個應用系統(tǒng)的角度，理解和分析PLD內(nèi)部鎖相環(huán)；在此基礎上，深入剖析鎖相環(huán)的相移結構，同時用這個技術解決系統(tǒng)設計難題。
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低壓CPLD EPM7512A的混合電壓系統(tǒng)設計
較詳細地闡述不同邏輯電平的接口原理。以低壓CPLD EPM7512A為例，給出在混合電壓系統(tǒng)中的具體設計方案。
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數(shù)字頻率合成器的FPGA實現(xiàn)
介紹了DDFS的原理和Altera公司的FPGA器件ACEX 1K的主要特點，給出了用ACEX 1K系列器件EP1K10TC144－1實現(xiàn)數(shù)字頻率合成器的工作原理、設計思路、電路結構和仿真結果。
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ISP技術在高速數(shù)據(jù)采集模塊中的應
提出了一種基于ISP技術實現(xiàn)高速數(shù)據(jù)采集的方法，給出了使用VHDL語言和原理圖完成數(shù)據(jù)采集模塊中地址發(fā)生器和比較電路的部分邏輯設計，只要將所設計的程序下載到可編程器件ispLSI2032中即可實現(xiàn)預期功能。
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用CPLD實現(xiàn)DSP與PLX9054之間的連接
介紹了利用CPLD實現(xiàn)DSP芯片TMS320C6711b和PCI橋芯片PLX9054之間高速數(shù)據(jù)傳輸?shù)南到y(tǒng)設計方法，并給出了相應的系統(tǒng)設計原理圖，同時對該系統(tǒng)的性能進行了分析。
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基于CPLD的三相多波形函數(shù)發(fā)生器設計
介紹了基于可編程邏輯器件CPLD和直接數(shù)字頻率合成技術（DDS）的三相多波形函數(shù)發(fā)生器的基本原理，并在此基礎上給出了基于CPLD的各模塊設計方法及其VHDL源程序。
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在系統(tǒng)可編程通用數(shù)字開關ispGDS14的原理及應用
介紹了Lattice公司生產(chǎn)的在系統(tǒng)可編程通用數(shù)字開關芯片ispGDS14的內(nèi)部結構和性能特點，并通過實例說明了在GDS開發(fā)環(huán)境下對ispGDS14進行編程的方法。
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基于邊界掃描的EPM9320LC84電路板故障診斷
文中在以ＰＣ機作為邊界掃描測試向量生成和故障診斷的基礎上，對單芯片——EPM9320LC84的印刷電路板故障診斷進行了一些討論。
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CPLD在發(fā)射機控制保護系統(tǒng)中的應用
CPLD在發(fā)射機控制保護系統(tǒng)中的應用。
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