信號量管理是操作系統(tǒng)中頻繁運行的程序段之一。為提高實時操作系統(tǒng)RTOS的響應能力,提出了基于FPGA硬件實現(xiàn)信號量管理的設計方案。采用片內(nèi)寄存器實現(xiàn)事件控制塊(ECB)、映射表等存儲結構,使用組合邏輯電路實現(xiàn)信號量管理模塊,提高了信號量創(chuàng)建、刪除及P/V操作的執(zhí)行速度。
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