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采用編譯增強技術，提高高密度FPGA設計工作效率
現(xiàn)場可編程門陣列（FPGA）體系創(chuàng)新以及向90nm工藝技術的過渡顯著提高了FPGA的密度和性能。FPGA設計人員不僅需要更高的邏輯密度和更快的性能表現(xiàn)，還要求具有嵌入式處理器、數(shù)字信號處理（DSP）模塊以及其他硬件IP結構等復雜的器件功能。但是，由于FPGA設計規(guī)模越來越大、越來越復雜，為了能夠抓住稍縱即逝的市場機會，設計人員必需盡快完成其設計。
現(xiàn)場可編程門陣列（FPGA）體系創(chuàng)新以及向90nm工藝技術的過渡顯著提高了FPGA的密度和性能。FPGA設計人員不僅需要更高的邏輯密度和更快的性能表現(xiàn)，還要求具有嵌入式處理器、數(shù)字信號處理（DSP）模塊以及其他硬件IP結構等復雜的器件功能。但是，由于FPGA設計規(guī)模越來越大、越來越復雜，為了能夠抓住稍縱即逝的市場機會，設計人員必需盡快完成其設計。
