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降低靜態(tài)功耗

關(guān)注人關(guān)注

我要報(bào)錯(cuò)

消費(fèi)電子中的降低功耗預(yù)算

像高端FPGA一樣，現(xiàn)在低密度的PLD有先進(jìn)的I/O功能，包括支持不同的I/O標(biāo)準(zhǔn)、多個(gè)I/O bank，以及多種電壓。這些特性允許使用PLD來實(shí)現(xiàn)ASIC/ ASSP、存儲器、處理器，以及通常有不匹配的電壓和I/O標(biāo)準(zhǔn)的其他器件之間的互連邏輯。

消費(fèi)電子
2019-07-24

FPGA 電源技術(shù)解析降低靜態(tài)功耗

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