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sdx總線(xiàn)

關(guān)注人關(guān)注

我要報(bào)錯(cuò)

基于VerilogHDL的SDX總線(xiàn)與Wishbone總線(xiàn)接口轉(zhuǎn)化的設(shè)計(jì)與實(shí)現(xiàn)

隨著微電子設(shè)計(jì)技術(shù)與工藝的迅速發(fā)展，數(shù)字集成電路逐步發(fā)展到專(zhuān)用集成電路(ASIC)，其中超大規(guī)模、高速、低功耗的新型FPGA的出現(xiàn)，降低了產(chǎn)品的成本，提高了系統(tǒng)的可靠性。同時(shí)，各種電子產(chǎn)品的復(fù)雜度和現(xiàn)代化程度的

電子設(shè)計(jì)自動(dòng)化
2015-03-11

FPGA sdx總線(xiàn) wishbone總線(xiàn)

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