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3-DES算法的FPGA高速實現(xiàn)
介紹3-DES算法的概要；以Xilinx公司SPARTANII結(jié)構(gòu)的XC2S100為例，闡述用FPGA高速實現(xiàn)3-DES算法的設計要點及關鍵部分的設計。
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零功耗超快速CPLD器件ispMACH4000Z及其應用
介紹了萊迪思半導體公司推出的零功耗超快速復雜中編程邏輯器件ispMACH4000Z的特征、結(jié)構(gòu)和原理。
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基于CPLD/FPGA的半整數(shù)分頻器的設計
簡要介紹了CPLD/FPGA器件的特點和應用范圍，并以分頻比為2.5的半整數(shù)分頻器的設計為例，介紹了在MAX+plus II開發(fā)軟件下，利用VHDL硬件描述語言以及原理圖的輸入方式來設計數(shù)字邏輯電路的過程和方法。
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硬件描述語言HDL的現(xiàn)狀與發(fā)展
從數(shù)字系統(tǒng)設計的性質(zhì)出發(fā)，結(jié)合目前迅速發(fā)展的芯片系統(tǒng)，比較、研究各種硬件描述語言。
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基于FPGA的總線型LVDS通信系統(tǒng)設計
本文介紹一種基于總線型LVDS的通信系統(tǒng)方案，以及利用FPGA芯片實現(xiàn)系統(tǒng)核心模塊的設計方法。
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用CPLD實現(xiàn)單片機讀寫模塊
介紹實現(xiàn)單片機與Xilinx公司XC9500系列可編程邏輯器件的讀寫邏輯功能模塊的接口設計，以及Xilinx公司的XC9500系列可編程邏輯器件的開發(fā)流程。
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用FPGA實現(xiàn)數(shù)據(jù)遠距離的高精度傳輸
詳細闡述一種利用交錯編碼的思想，來改遠距離通信質(zhì)量的新設計。
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用CPLD控制曼徹斯特編解碼器
討論如何使用CPLD實現(xiàn)單片機與曼徹斯特編解碼器的接口。
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基于FPGA的多路模擬量、數(shù)字量采集與處理系統(tǒng)
提出一種基于FPGA技術(shù)的多路模擬量、數(shù)字量采集與處理系統(tǒng)的設計方案，分析整個系統(tǒng)的結(jié)構(gòu)，并討論FPGA內(nèi)部硬件資源的劃分和軟件的設計方案等。
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在PLD開發(fā)中提高VHDL的綜合質(zhì)量
介紹可編程邏輯器件的開發(fā)流程，敘述EDA工具Quartus II和LeonardoSpectrum在Altera公司CPLD器件開發(fā)中的應用。
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