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上拉和下拉電阻的作用概括如下:



1


提高電壓準(zhǔn)位


當(dāng)TTL電路驅(qū)動(dòng)CMOS電路時(shí),如果TTL電路輸出的高電平低于CMOS電路的最低高電平,這時(shí)就需要在TTL的輸出端接上拉電阻,以提高輸出高電平的值;OC門(mén)電路必須加上拉電阻,以提高輸出的高電平值。


2


加大輸出引腳的驅(qū)動(dòng)能力


有的單片機(jī)引腳上也常使用上拉電阻。


3


N/A引腳(沒(méi)有連接的引腳)防靜電、防干擾


在CMOS芯片上,為了防止靜電造成損壞,不用的引腳不能懸空,一般接上拉電阻降低輸入阻抗,提供泄荷通路。同時(shí)引腳懸空就比較容易接收外界的電磁干擾。


4


電阻匹配


抑制反射波干擾,長(zhǎng)線(xiàn)傳輸中電阻不匹配容易引起反射波干擾,加上下拉電阻使電阻匹配,能有效的抑制反射波干擾。


5


預(yù)設(shè)空間狀態(tài)/默認(rèn)電位


在一些CMOS輸入端接上拉或下拉電阻是為了預(yù)設(shè)默認(rèn)電位。當(dāng)不用這些引腳時(shí),這些輸入端下拉接低電平或上拉接高電平。在I2C等總線(xiàn)上空閑時(shí)的狀態(tài)是由上下拉電阻獲得的。


6


提高芯片輸入信號(hào)的噪聲容限


輸入端如果是高阻狀態(tài),或高阻抗輸入端處于懸空狀態(tài),此時(shí)需要加上拉或下拉電阻,以免受到隨機(jī)電平的影響,進(jìn)而影響電路工作。同樣,如果輸出端處于被動(dòng)狀態(tài),需要加上拉或下拉電阻,如輸出端僅僅是一個(gè)三極管的集電極,從而提高芯片輸入信號(hào)的噪聲容限,增強(qiáng)抗干擾能力。



在BJT晶體三極管的基極端,上拉電阻和下拉電阻也起著至關(guān)重要的作用。在三極管的電路應(yīng)用中,串接在基極上的電阻起限制基級(jí)電流的作用,如下圖中的R2所示,





如下圖中的R5所示,上拉電阻使三極管基極的輸入電平在默認(rèn)情況下是高電平輸入,當(dāng)CPU有低電平信號(hào)輸出時(shí),外圍電路響應(yīng),下拉電阻使晶體管的基極輸入在默認(rèn)情況下拉到低電平,如下圖中的R6所示。





End





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