電子技術的發(fā)展變化必然給板級設計帶來許多新問題和新挑戰(zhàn)。首先,由于高密度引腳及引腳尺寸日趨物理極限,導致低的布通率;其次,由于系統(tǒng)時鐘頻率的提高,引起的時序及信號完整性問題;第三,工程師希望能在PC平臺上用更好的工具完成復雜的高性能的設計。
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