信號完整性和器件的特性阻抗

在您努力想要穩(wěn)定板上的各種信號時(shí)，信號完整性問題會帶來一些麻煩。IBIS 模型是解決這些問題的一種簡單方法。您可以利用 IBIS 模型提取出一些重要的變量，用于進(jìn)行信號完整

INA共模范圍可能會是一個(gè)難題

在之前的文章（《了解共模抑制和儀表放大器》）中我們簡單描述了三運(yùn)放儀表放大器 (INA) 的內(nèi)部工作原理，我們找到了造成總 CMR 誤差的主要原因。如果看一下相同器件的共模

述評SPARQ系列網(wǎng)絡(luò)分析儀之二：信號完整性問題與S參數(shù)關(guān)系

隨著半導(dǎo)體工藝的不斷發(fā)展，數(shù)字信號的速率也愈來愈高，Gbps以上的高速信號已經(jīng)隨處可見。面對高速設(shè)計(jì)的新領(lǐng)域，硬件設(shè)計(jì)工程師們需要改 變傳統(tǒng)的設(shè)計(jì)理念，他們需要以更加超前的思維去思考自己將要設(shè)計(jì)的信號的質(zhì)量

從信號完整性角度談如何選擇示波器

在基礎(chǔ)的電子信號測量中，我們通常會選用示波器來對信號進(jìn)行測量。因此，如何選擇一款有利于信號完整性測量的示波器尤為重要。(文中主要討論的為數(shù)字示波器)接下來我們主要從幾個(gè)大方向介紹了哪些因素會影響信號完整性的測量。

保障系統(tǒng)信號完整性測量，您必須知道的探頭ABC

基于DSP的列車應(yīng)變力測試系統(tǒng)設(shè)計(jì)

本文介紹了基于TMS320VC33 DSP芯片的應(yīng)變力測試系統(tǒng)的設(shè)計(jì)，給出了結(jié)構(gòu)原理框圖，并圍繞DSP設(shè)計(jì)了測試系統(tǒng)的中斷、復(fù)位子系統(tǒng)、存儲子系統(tǒng)和通信子系統(tǒng)。同時(shí)還對測試系統(tǒng)進(jìn)行了信號完整性分析。

信號完整性分析基礎(chǔ)系列之五--抖動的分類

10G-32G數(shù)字系統(tǒng)信號完整性測量技術(shù)白皮書

前言 云計(jì)算等高速數(shù)字系統(tǒng)是后IT時(shí)代推動力量之一。 云計(jì)算和其他高速數(shù)字系統(tǒng)對數(shù)據(jù)帶寬要求非常巨大，使得整個(gè)系統(tǒng)的單根信號速率突破10Gbps，20Gbps甚至達(dá)到28Gbps的超高數(shù)量級。超過10GHz的數(shù)字系統(tǒng)，對各種

信號完整性分析基礎(chǔ)之六--直方圖在抖動分析中的應(yīng)用

信號完整性分析基礎(chǔ)系列之二--關(guān)于眼圖測量（下）

信號完整性分析基礎(chǔ)系列之三--串行數(shù)據(jù)測試中的CDR

信號完整性分析基礎(chǔ)系列之二十二—— 自定義二階PLL

概述本文介紹了自定義二階PLL，說明了它如何正確應(yīng)用于串行數(shù)據(jù)測量中以提高眼圖和抖動測量精度。抖動定義的是邊沿的時(shí)序不確定性。為了確定串行數(shù)據(jù)信號邊沿的時(shí)序不確定性，邊沿需要和一個(gè)參考的時(shí)鐘邊沿進(jìn)行比較。

信號完整性的常用的三種測試方法

　　信號完整性的測試手段主要可以分為三大類，下面對這些手段進(jìn)行一些說明。 　　抖動測試 　　抖動測試現(xiàn)在越來越受到重視，因?yàn)閷Ｓ玫亩秳訙y試儀器，比如TIA(時(shí)間間隔分析儀)、SIA3000，價(jià)格非常昂貴

信號完整性分析基礎(chǔ)之七——JitterTrack在抖動分析中的應(yīng)用

在上一篇文章中我們介紹了直方圖的概念以及如何使用直方圖的方法來分析抖動（也即從統(tǒng)計(jì)域的角度來分析）。從抖動的直方圖中我們可以看出抖動的分布特征（隨機(jī)分布、雙峰分布等），通過測試直方圖的標(biāo)準(zhǔn)

信號完整性分析系列之八——抖動的頻域分析

在上兩篇文章中，我們分別介紹了直方圖（統(tǒng)計(jì)域分析）和抖動追蹤（時(shí)域分析）在抖動分析中的應(yīng)用。從抖動的直方圖和抖動追蹤波形上我們可以得到抖動的主要構(gòu)成成分以及抖動參數(shù)的變化趨勢。如需對抖動的

信號完整性分析基礎(chǔ)之十——串行數(shù)據(jù)測試的總體抖動算法

在高速串行數(shù)據(jù)的測試中，抖動的測試非常重要。在串行數(shù)據(jù)的抖動測試中，抖動定義為信號的邊沿與其參考時(shí)鐘之間的偏差。對于抖動測量值的量化，通常有抖動的峰峰值和有效值這兩個(gè)參數(shù)。不過，抖動的峰峰

信號完整性基礎(chǔ)系列之十一——力科SDA的三種抖動分解方法

在通訊和PC行業(yè)，高速串行信號越來越普及，在使用示波器測量和分析這類信號時(shí)，通常要求測量總體抖動（Total jitter，簡稱Tj）和固有抖動（Deterministic jitter，簡稱Dj），驗(yàn)證是否滿足相關(guān)規(guī)范的要求

信號完整性基礎(chǔ)系列之十三——ISI和ISI Plot

一，關(guān)于ISI的文章典籍有哪些？關(guān)于ISI，有兩本比較有名的SI著作中有提到。在Intel的三位工程師合著的《高速數(shù)字系統(tǒng)設(shè)計(jì)——互連理論和設(shè)計(jì)實(shí)踐手冊》(p65-p66)中，對ISI的解釋是：“當(dāng)信號沿傳輸線傳

高手支招，電路板設(shè)計(jì)中如何確保信號完整性？

信號完整性(SI)問題解決得越早，設(shè)計(jì)的效率就越高，從而可避免在電路板設(shè)計(jì)完成之后才增加端接器件。SI設(shè)計(jì)規(guī)劃的工具和資源不少，本文探索信號完整性的核心議題以及解決SI問題的幾種方法，在此忽略設(shè)計(jì)過程的技術(shù)細(xì)節(jié)。

信號完整性與電源完整性的詳細(xì)分析

最近在論壇里看到一則關(guān)于電源完整性的提問，網(wǎng)友質(zhì)疑大家普遍對信號完整性很重視，但對于電源完整性的重視好像不夠，主要是因?yàn)?，對于低頻應(yīng)用，開關(guān)電源的設(shè)計(jì)更多靠的是