分頻器

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模擬分頻器是音箱內的一種電路裝置，用以將輸入的模擬音頻信號分離成高音、中音、低音等不同部分，然后分別送入相應的高、中、低音喇叭單元中重放。之所以這樣做，是因為任何單一的喇叭都不可能完美的將聲音的各個頻段完整的重放出來。

阻抗補償電路

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音頻視頻電路
2013-10-19

阻抗補償電路 BSP 分頻器
發(fā)燒三板斧HI-FI

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測試測量電路
2013-09-09

功放音箱 HI-FI 分頻器
兩種有源二分頻功放電路01

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測試測量電路
2013-09-09

低通功放電路 KHZ 分頻器
高品質立體聲HI-FI組合放大器06

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測試測量電路
2013-07-17

放大器立體聲 HI-FI 分頻器
PIC單片機指令周期計算

PIC單片機的每四個時鐘周期為一個內部指令周期例如：8MHz的晶振,則內部指令周期為1/(8/4)= 0.5 uS實例一：35us， 8MHz的晶振, 8位定時器, 分頻比1/2 , 初值 E4實例二：156.25us , 32768Hz的晶振, 8位定時器, 分頻比1

單片機
2013-05-07

單片機指令指令周期 PIC單片機分頻器
1.5GHz預分頻器電路圖

摩托羅拉MC1697芯片提供4分法擴大400MHz計數器范圍，頻率大于1.5GHz。輸入信號低至1mW，電路運行。所需電源為60mA，-7V。文章給出了構造和測試的細節(jié)。

基礎實用電路
2013-02-25

信號電路圖 5GHZ 分頻器
STM32學習之時鐘

STM32學習----時鐘收藏在STM32中，有五個時鐘源，為HSI、HSE、LSI、LSE、PLL。①、HSI是高速內部時鐘，RC振蕩器，頻率為8MHz。②、HSE是高速外部時鐘，可接石英/陶瓷諧振器，或者接外部時鐘源，頻率范圍為4MHz~16MH

單片機
2013-02-19

時鐘 STM32 SE 分頻器
PIC看門狗定時器的理解

pic單片機看門狗計時器（Watch Dog Timer）是一個片內自振式的RC振蕩計時器，無需任何的外接元件。這意味著即使芯片OSC1/OSC2上振蕩停止了（例如執(zhí)行指令SLEEP后），WDT照樣保持計時。WDT計時溢出將產生RESET。在PIC

單片機
2012-12-13

看門狗定時器 PIC RESET 分頻器
用于SOC或塊級時鐘的可配置分頻器

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嵌入式教程
2012-12-08

SoC 時鐘時鐘分頻分頻器
倍頻電路的預置可逆分頻器設計

摘要：首先分析了應用于倍頻電路的預置可逆分頻器的工作原理，推導了觸發(fā)器的驅動函數。并建立了基于simulink 和FPGA 的分頻器模型，實驗結果表明分頻器可以實現預置模和可逆分頻功能，滿足倍頻電路需要。1. 前言鎖相

模擬
2012-11-11

FPGA 倍頻電路 BSP 分頻器
1.5GHz預分頻器電路圖

摩托羅拉MC1697芯片提供4分法擴大400MHz計數器范圍，頻率大于1.5GHz。輸入信號低至1mW，電路運行。所需電源為60mA，-7V。文章給出了構造和測試的細節(jié)。

基礎實用電路
2012-10-11

電路圖 WIDTH 5GHZ 分頻器
基于FPGA的雙模前置小數分頻器的設計簡介

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嵌入式教程
2012-09-08

FPGA 雙模 VI 分頻器
±5V穩(wěn)壓分頻器

該電路用于可調穩(wěn)壓電源輸出，提供15V電壓，以產生較低正負極電壓，并保持穩(wěn)定，但負載電流改變。＋10V時獲得＋5V和－5V，R1設置在中間的位置，通過輸出晶體管將R2調整為20mA。該電路采用741運算放大器。

電源電路
2012-09-05

穩(wěn)壓 IC WIDTH 分頻器
±5V穩(wěn)壓分頻器

該電路用于可調穩(wěn)壓電源輸出，提供15V電壓，以產生較低正負極電壓，并保持穩(wěn)定，但負載電流改變。＋10V時獲得＋5V和－5V，R1設置在中間的位置，通過輸出晶體管將R2調整為20

電源電路
2012-09-05

電路穩(wěn)壓 WIDTH 分頻器
基于FPGA應用于倍頻電路的預置可逆分頻器設計

摘要：首先分析了應用于倍頻電路的預置可逆分頻器的工作原理，推導了觸發(fā)器的驅動函數。并建立了基于simulink 和FPGA 的分頻器模型，實驗結果表明分頻器可以實現預置模和可逆分頻功能，滿足倍頻電路需要。1. 前言鎖相

電子設計自動化
2012-08-20

FPGA 觸發(fā)器倍頻電路分頻器
基于VHDL和FPGA的多種分頻實現方法介紹

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嵌入式教程
2012-07-30

FPGA 計數器 VHDL 分頻器
音響電路中如何選擇電容

音響電路中通常包括濾波、耦合、旁路、分頻等電容，如何在電路中更有效地選擇使用各種不同類型的電容器對音響音質的改善具有較大的影響。耦合電容耦合電容的容量一般在 0.1μF - 10μF 之間，以使用云母、聚丙烯

模擬
2012-07-25

電容音響電路 IC 分頻器
FPGA/CPLD中常見模塊設計精華集錦（一）

一、智能全數字鎖相環(huán)的設計　　1 引言　　數字鎖相環(huán)路已在數字通信、無線電電子學及電力系統(tǒng)自動化等領域中得到了極為廣泛的應用。隨著集成電路技術的發(fā)展，不僅能夠制成頻率較高的單片集成鎖相環(huán)路，而且可以把整

電子設計自動化
2012-06-14

模塊設計計數器 FPGA/CPLD 分頻器
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數字電源
2012-06-12

模塊設計計數器 FPGA/CPLD 分頻器
FPGA/CPLD中常見模塊設計精華集錦（一）

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嵌入式軟件
2012-06-12

模塊設計計數器 FPGA/CPLD 分頻器

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