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基于FPGA/CPLD的嵌入式VGA顯示系統(tǒng)
基于FPGA/CPLD的嵌入式VGA顯示系統(tǒng)
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使用邏輯分析儀調試時序問題
時序問題對于許多嵌入式設計來說是相當常見的，故障排除可能是一個耗時的任務。使用正確的邏輯分析儀將簡化和加快這一進程。對比指標時，許多邏輯分析儀似乎有相同的性能，但為了確保邏輯分析儀能夠正確地采集信號，快速地找到問題，你不能只看指標，還需要考慮到邏輯分析儀的結構和功能。
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測試3G手機的DigRF技術
DigRF準備替換RF與基帶半導體器件之間的兩種主要形式的數據通信路徑：模擬信令，以及針對具體設計的私有數字信令（并行或串行）。MIPI（移動業(yè)處理器接口）聯(lián)盟正在致力于采用DigRF（數字射頻）標準，用一種基于
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測試3G手機的DigRF技術
DigRF準備替換RF與基帶半導體器件之間的兩種主要形式的數據通信路徑：模擬信令，以及針對具體設計的私有數字信令（并行或串行）。MIPI（移動業(yè)處理器接口）聯(lián)盟正在致力于采用DigRF（數字射頻）標準，用一種基于
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環(huán)形時序發(fā)生器
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成功解決FPGA設計時序問題的三大要點
FPGA的設計與高速接口技術可以幫助你滿足今天的市場要求，但也提出了一些有趣的設計挑戰(zhàn)。為了確保存儲器接口的數據傳輸準確，在超過200兆赫茲以上，進行時序分析將發(fā)揮更突出的作用，以識別和解決系統(tǒng)運行的問題。在
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8位液晶譯碼驅動MAX7232BF的原理及應用
MAX7232BF為串行輸入4位數據、2位小數點和4位地址；輸出為10位數據加20個獨立小數點，數據輸出代碼為BCD碼，每一位的2個小數點都在COM3上?？梢灾苯优c微處理器連接。 1 管腳結構及說明 MAX7232BF具有雙列直插
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行間轉移型面陣CCD圖像采集系統(tǒng)的研究
0 引言 電荷耦合器件(charge coupled devices CCD)作為一種高性能的光電圖像傳感器，具有光譜響應寬、線性好、動態(tài)范圍寬、噪聲低、靈敏度高、實時傳輸和電荷掃描等多方面優(yōu)點，目前已廣泛應用于圖像傳感和非接
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65納米高性能網絡交換處理器（創(chuàng)意電子）
臺灣創(chuàng)意電子（GUC）成功完成一款65納米高性能網絡交換處理器的設計，具有5000萬門級和400兆赫茲的運行速度。 創(chuàng)意電子使用Cadence® Encounter®數字實現(xiàn)系統(tǒng)設計出了大型、復雜的芯片，整體芯片設計時間實現(xiàn)
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8位液晶譯碼驅動MAX7232BF的原理及應用
MAX7232BF為串行輸入4位數據、2位小數點和4位地址；輸出為10位數據加20個獨立小數點，數據輸出代碼為BCD碼，每一位的2個小數點都在COM3上?？梢灾苯优c微處理器連接。 1 管腳結構及說明 MAX7232BF具有雙列直插
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行間轉移型面陣CCD圖像采集系統(tǒng)的研究
0 引言 電荷耦合器件(charge coupled devices CCD)作為一種高性能的光電圖像傳感器，具有光譜響應寬、線性好、動態(tài)范圍寬、噪聲低、靈敏度高、實時傳輸和電荷掃描等多方面優(yōu)點，目前已廣泛應用于圖像傳感和非接
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測試檢驗電路時序的FPGA邏輯驗證分析儀
隨著FPGA技術的廣泛使用，越來越需要一臺能夠測試驗證FPGA芯片中所下載電路邏輯時序是否正確的儀器。目前，雖然Agilent、Tektronix 等大公司生產的高端邏輯分析儀能夠實現(xiàn)FPGA電路的測試驗證功能，但此類儀器價格
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基于FPGA的線陣CCD驅動時序及 模擬信號處理的設計
為保證線陣CCD在圖像測量中正常、穩(wěn)定工作，必須設計出適合其工作的時序驅動電路。在分析TCDl501D線陣CCD驅動時序關系的基礎上，通過分析CCD輸出的圖像信號，給出了內、外相關雙采樣的時序控制。最后，利用quanus7．2軟件平臺結合VHDL語言進行開發(fā)，對所需驅動脈沖進行仿真設計。仿真結果表明，該驅動電路簡單、功耗小、成本低、抗干擾能力強，適用于設備小型化的要求。
江陽
朱德榮
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瞎折騰
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海中水
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