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基于AT89C51+DSP的雙CPU伺服運動控制器的研究
采用單片機與DSP配合,系統的運算和實時處理的能力大大增強,可以適應多坐標軸、高速度、高精確度的數控系統,實現單處理器系統難以實現的功能. 與由單處理器完成所有任務的情況相比,該方法允許較短的插補周期,實現更高的進給和伺服控制精確度. 并經實驗證明該伺服運動控制器反向速度快、定位時間短、轉矩恒定,具有良好的線性調速特性及動態(tài)性能.
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異步DSP核心設計:更低功耗,更高性能
目前，處理器性能的主要衡量指標是時鐘頻率。絕大多數的集成電路 (IC) 設計都基于同步架構，而同步架構都采用全球一致的時鐘。這種架構非常普及，許多人認為它也是數字電路設計的唯一途徑。然而，有一種截然不同的設計技術即將走上前臺：異步設計。 這一新技術的主要推動力來自硅技術的發(fā)展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。 異步技術由于諸多原因曾經備受冷落，其中最重要的是缺乏標準化的工具流。IC 設計團隊面臨著巨大的壓力，包括快速地交付設備，使用高級編程語言和標準的事件驅動架構 (EDA) 工具，幫助實施合成、定時和驗證等任務。如果異步設計可以使用此類工具，那么可以預計將會出現更多采用異步邏輯組件的設備。
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基于DSP的磁流變阻尼器的控制方法
以美國德州儀器公司推出的十六位定點通用數字信號處理芯片DSP為核心開發(fā)出精確可控的電流控制器，電流可在0~1.5A范圍內調節(jié)，輸出電流精度高，線性度好，控制效果顯著。
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基于DSP Builder的14階FIR濾波器的設計
數字濾波器在數字信號處理的各種應用中發(fā)揮著十分重要的作用，他是通過對采樣數據信號進行數學運算處理來達到頻域濾波的目的。數字濾波器既可以是有限長單脈沖響應(FIR)濾波器也可以是無限長單脈沖響應(IIR)濾波器。在維納濾波器理論發(fā)明的早期，人們使用IIR濾波器，但現在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設計一個FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發(fā)軟件的DSP開發(fā)工具。在DSP Builder的無縫設計流程中，首先在Matlab軟件中進行算法設計，然后在Simulink軟件中進行系統集成，最后將設計輸出為硬件描述語言(HDL)文件，以便在QuartusⅡ軟件中使用。
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異步 DSP 核心設計: 更低功耗，更高性能
這一新技術的主要推動力來自硅技術的發(fā)展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。
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DSP在平行雙輪電動車控制系統中的應用
2001年，美國發(fā)明家Kamen發(fā)明了一種新型的方便快捷的兩輪交通工具“Segway”，行走平衡控制技術成為全球機器人控制技術的研究熱點。以平行雙輪電動車作為移動平臺為機器人的研究提供了技術支持，同時由于他的行為與火箭飛行和兩足機器人有很大的相似性，因而對其運動平衡控制研究具有重大的理論和實際意義。文獻[2]介紹了平行雙輪電動車的控制器電路，以C8051F020單片機為控制核心通過調整車體平臺的運行位置，從而使車體平臺始終保持平衡狀態(tài)。然而其并沒有考慮載人、載物的因素以及轉向和特殊路面、打滑等方面。再者，
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基于USB接口和DSP的飛機防滑剎車測試系統設計
提出了以DSP為控制核心，采用USB通信設計的飛機防滑剎車測試系統。分析了飛機防滑剎車測試系統的組成，并介紹了測試系統主要硬件電路設計和系統上下位機軟件設計。
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基于AT89C51+DSP的雙CPU伺服運動控制器的研究
采用單片機與DSP配合,系統的運算和實時處理的能力大大增強,可以適應多坐標軸、高速度、高精確度的數控系統,實現單處理器系統難以實現的功能. 與由單處理器完成所有任務的情況相比,該方法允許較短的插補周期,實現更高的進給和伺服控制精確度. 并經實驗證明該伺服運動控制器反向速度快、定位時間短、轉矩恒定,具有良好的線性調速特性及動態(tài)性能.
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異步DSP核心設計:更低功耗,更高性能
目前，處理器性能的主要衡量指標是時鐘頻率。絕大多數的集成電路 (IC) 設計都基于同步架構，而同步架構都采用全球一致的時鐘。這種架構非常普及，許多人認為它也是數字電路設計的唯一途徑。然而，有一種截然不同的設計技術即將走上前臺：異步設計。 這一新技術的主要推動力來自硅技術的發(fā)展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。 異步技術由于諸多原因曾經備受冷落，其中最重要的是缺乏標準化的工具流。IC 設計團隊面
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基于DSP的磁流變阻尼器的控制方法
以美國德州儀器公司推出的十六位定點通用數字信號處理芯片DSP為核心開發(fā)出精確可控的電流控制器，電流可在0~1.5A范圍內調節(jié)，輸出電流精度高，線性度好，控制效果顯著。
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基于DSP Builder的14階FIR濾波器的設計
數字濾波器在數字信號處理的各種應用中發(fā)揮著十分重要的作用，他是通過對采樣數據信號進行數學運算處理來達到頻域濾波的目的。數字濾波器既可以是有限長單脈沖響應(FIR)濾波器也可以是無限長單脈沖響應(IIR)濾波器。在維納濾波器理論發(fā)明的早期，人們使用IIR濾波器，但現在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設計一個FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發(fā)軟件的DSP開發(fā)工具。在DSP
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異步 DSP 核心設計: 更低功耗，更高性能
這一新技術的主要推動力來自硅技術的發(fā)展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。
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一種基于DSP平臺的快速H.264編碼算法的設計
視頻壓縮編碼標準H.264／AVC是由ISO／IEC和ITU-T組成的聯合視頻專家組(JVT)制定的，他引進了一系列先進的視頻編碼技術，如4×4整數變換、空域內的幀內預測，多參考幀與多種大小塊的幀間預測技術等，標準一經推出，就以其高效的壓縮性能和友好的網絡特性受到業(yè)界的廣泛推崇。
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DSP應用系統中的硬件接口電路設計
介紹了DSP應用系統的硬件接口電路：包括電平變換電路、仿真器JTAG接口電路、以及可擴展的硬件接口（如A/D、D/A、SRAM）等的設計方法，并給出了接口電路在設計時須注意的幾個問題。
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基于DSP多處理器實時開發(fā)環(huán)境的設計
本文通過研究提出了一種多處理器實時開發(fā)環(huán)境的設計思想，它可以支持多種型號處理器的同時開發(fā)，使系統級開發(fā)變得簡單易行。
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基于DSP和模糊控制的尋線行走機器人設計與實現
針對機器人比賽和電子設計競賽中機器人尋線行走的普遍要求，提出了一種通用的尋線行走機器人的設計方法。機器人的核心控制器包括實現控制算法的DSP和用于擴展功能實現的CPLD；對來自光電檢測傳感器的信號采用模糊控制規(guī)則進行綜合，核心控制器根據模糊控制器輸出調整機器人的行走路線，最終實現機器人尋線行走。
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32位DSP兩級cache的結構設計
采用自頂向下的流程設計了一款32位DSP的cache。該cache采用兩級結構，第一級采用哈佛結構，第二級采用普林斯頓結構。本文詳細論述了該cache的結構設計及采用的算法。
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FPGA+DSP實時三維圖像信息處理系統
一種基于高性能FPGA+DSP核心架構的實時三維圖像信息處理系統。介紹了系統硬件結構和數據處理流程，按模塊分析了硬件設計和邏輯連接，給出了圖像預處理和三維重建算法的硬件實現流程。
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CEVA與ARM合作增強開發(fā)DSP+ARM多處理器SoC
硅產品知識產權(SIP)平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司宣布與ARM合作，針對多處理器系統級芯片(SoC)解決方案的開發(fā)，在ARM CoreSight技術實現CEVA DSP內核的實時跟蹤支持。這種強化的支持將
