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FPGA

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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
  • 基于FPGA的智能營區(qū)防沖擊系統(tǒng)設計

    摘要:為提高安防措施,延緩不法分子動作,確保營區(qū)安全,提出一種營區(qū)智能防沖擊系統(tǒng)解決方案。該方案以移動物體的外形形狀、車牌信息、車輛速度為輸入特征,采用虛擬線圈感應、車牌識別、車輛測速、系統(tǒng)控制等方法

  • Altera 28-nm精度可調DSP贏得2011設計創(chuàng)意獎

    Altera公司日前宣布,其精度可調數(shù)字信號處理(DSP)模塊體系結構贏得DesignCon 2011半導體和IC類的設計創(chuàng)意獎。Altera的精度可調DSP模塊體系結構之所以能夠得到設計創(chuàng)意獎的認可,源自其FPGA內置的高精度、高性能數(shù)

  • 基于FPGA和NiosII的逆變焊接電源控制器

    摘要:設計了基于FPGA和NioslI軟核的全數(shù)字逆變焊接電源控制器,采用變參數(shù)PID和改進的I-I型雙閉環(huán)電流-弧長控制策略,并應用于數(shù)字化MIG焊接電源系統(tǒng)中。介紹了該電源控制器各模塊的功能及設計方案,分析了MIG焊接電

  • Altera 28-nm精度可調DSP模塊體系結構贏得2011設計創(chuàng)意獎

    Altera公司日前宣布,其精度可調數(shù)字信號處理(DSP)模塊體系結構贏得DesignCon 2011半導體和IC類的設計創(chuàng)意獎。Altera的精度可調DSP模塊體系結構之所以能夠得到設計創(chuàng)意獎的認可,源自其FPGA內置的高精度、高性能數(shù)字

  • 基于FPGA的多DSP紅外實時圖像處理系統(tǒng)

    多處理器系統(tǒng)已廣泛應用于高速信號處理領域,為提高系統(tǒng)性能,更好地發(fā)揮多處理器優(yōu)勢,介紹采用基于FPGA的多DSF架構。利用FPGA作為數(shù)據(jù)調度核心,將處理器從繁雜的數(shù)據(jù)通信工作中解放出來,充分發(fā)揮了多處理器的并行工作能力,增強了系統(tǒng)的重構和拓展性。該系統(tǒng)已應用于工程實踐中,以一塊高密度電路板實現(xiàn)了從數(shù)據(jù)采集到圖像校正、圖像處理,以及圖像顯示的整個流程,能夠滿足對處理時間要求較高、較為復雜的圖像處理算法的要求。

  • 適用于LatticeECP3 FPGA系列的IP套件(萊迪思)

    萊迪思半導體公司日前發(fā)布了即可獲取的五款新的全面的知識產(chǎn)權(IP)套件,用于加速在各行業(yè)使用屢獲殊榮的LatticeECP3™ FPGA系列的電子系統(tǒng)設計。這五款IP套件分別是PCI Express、以太網(wǎng)網(wǎng)絡、數(shù)字信號處理、

  • 賽靈思收購AUTOESL擴展可編程平臺優(yōu)勢

    showAd(2009080513234060,236,236); 賽靈思宣布收購高層綜合技術領先公司美國AutoESL設計科技有限公司。 通過增加高層綜合技術,賽靈思進一步擴展了其技術基礎和產(chǎn)品組合,使得公司能夠把可編程平臺的優(yōu)勢帶給更

  • 賽靈思宣布收購AUTOESL

    全球可編程平臺廠商賽靈思公司(Xilinx, Inc)宣布收購高層綜合技術公司美國AutoESL設計科技有限公司。 通過增加高層綜合技術,賽靈思進一步擴展了其技術基礎和產(chǎn)品組合,使得公司能夠把可編程平臺的優(yōu)勢帶給更廣

  • 賽靈思收購高層綜合技術公司AUTOESL,擴展可編程平臺優(yōu)勢

    關鍵字: 可編程平臺 電子系統(tǒng)級 FPGA DSP 賽靈思宣布收購高層綜合技術領先公司美國Au

  • 基于FPGA的智能營區(qū)防沖擊系統(tǒng)設計

    摘要:為提高安防措施,延緩不法分子動作,確保營區(qū)安全,提出一種營區(qū)智能防沖擊系統(tǒng)解決方案。該方案以移動物體的外形形狀、車牌信息、車輛速度為輸入特征,采用虛擬線圈感應、車牌識別、車輛測速、系統(tǒng)控制等方法

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  • 基于FPGA和NiosII的逆變焊接電源控制器

    基于FPGA和NiosII的逆變焊接電源控制器

  • 基于FPGA的24×24位低功耗乘法器的設計

    通過對現(xiàn)有編碼算法的改進,提出一種新的編碼算法,它降低功耗的方法是通過減少部分積的數(shù)量來實現(xiàn)的。因為乘法器的運算主要是部分積的相加,因此,減少部分積的數(shù)量可以降低乘法器中加法器的數(shù)量,從而實現(xiàn)功耗的減低。在部分積的累加過程中.又對用到的傳統(tǒng)全加器和半加器進行了必要的改進,避免了CMOS輸入信號不必要的翻轉,從而降低了乘法器的動態(tài)功耗。通過在Altera公司的FPGA芯片EP2CTOF896C中進行功耗測試,給出了測試結果,并與現(xiàn)有的兩種編碼算法進行了比較。功耗分別降低3.5%和8.4%。

  • 基于FPGA的多時鐘片上網(wǎng)絡設計

    本文介紹了一個基于FPGA 的高效率多時鐘的虛擬直通路由器,通過優(yōu)化中央仲裁器和交叉點矩陣,以爭取較小面積和更高的性能。同時,擴展路由器運作在獨立頻率的多時鐘NoC 架構中,并在一個3×3Mesh 的架構下實驗,分析其性能特點,比較得出多時鐘片上網(wǎng)絡具有更高的性能。

  • 基于DSP+FPGA多視頻通道的切換控制

    為了擴大監(jiān)控范圍,提高資源利用率,降低系統(tǒng)成本,提出了一種多通道視頻切換的解決方案。首先從視頻信號分離出行場信號,然后根據(jù)行場信號由DSP和FPGA產(chǎn)生控制信號,控制多路視頻通道之間的切換,從而實現(xiàn)讓一個視頻處理器同時監(jiān)控不同場景。實驗結果表明,誼方案可以在視頻監(jiān)控告警系統(tǒng)中穩(wěn)定、可靠地實現(xiàn)視頻通道的切換。

  • 基于FPGA的24×24位低功耗乘法器的設計

    通過對現(xiàn)有編碼算法的改進,提出一種新的編碼算法,它降低功耗的方法是通過減少部分積的數(shù)量來實現(xiàn)的。因為乘法器的運算主要是部分積的相加,因此,減少部分積的數(shù)量可以降低乘法器中加法器的數(shù)量,從而實現(xiàn)功耗的減低。在部分積的累加過程中.又對用到的傳統(tǒng)全加器和半加器進行了必要的改進,避免了CMOS輸入信號不必要的翻轉,從而降低了乘法器的動態(tài)功耗。通過在Altera公司的FPGA芯片EP2CTOF896C中進行功耗測試,給出了測試結果,并與現(xiàn)有的兩種編碼算法進行了比較。功耗分別降低3.5%和8.4%。

  • 基于DSP+FPGA多視頻通道的切換控制

    為了擴大監(jiān)控范圍,提高資源利用率,降低系統(tǒng)成本,提出了一種多通道視頻切換的解決方案。首先從視頻信號分離出行場信號,然后根據(jù)行場信號由DSP和FPGA產(chǎn)生控制信號,控制多路視頻通道之間的切換,從而實現(xiàn)讓一個視頻處理器同時監(jiān)控不同場景。實驗結果表明,誼方案可以在視頻監(jiān)控告警系統(tǒng)中穩(wěn)定、可靠地實現(xiàn)視頻通道的切換。

  • 賽靈思宣布收購 AUTOESL

    賽靈思公司 (Xilinx, Inc.)宣布收購高層綜合技術領先公司美國AutoESL設計科技有限公司。通過增加高層綜合技術,賽靈思進一步擴展了其技術基礎和產(chǎn)品組合,使得公司能夠把可編程平臺的優(yōu)勢帶給更廣泛的企業(yè)用戶群體