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[導(dǎo)讀]觸發(fā)器子Ⅵ能夠根據(jù)觸發(fā)源的不同,對輸入的信號進行選擇后輸出。創(chuàng)建該子Ⅵ的過程和前面的創(chuàng)建過程相同,將創(chuàng)建后的子Ⅵ保存為“trigger.vi”。創(chuàng)建后的觸發(fā)器子Ⅵ的前面板如圖1所示。在前面板添加觸發(fā)源&

觸發(fā)器子Ⅵ能夠根據(jù)觸發(fā)源的不同,對輸入的信號進行選擇后輸出。創(chuàng)建該子Ⅵ的過程和前面的創(chuàng)建過程相同,將創(chuàng)建后的子Ⅵ保存為“trigger.vi”。創(chuàng)建后的觸發(fā)器子Ⅵ的前面板如圖1所示。在前面板添加觸發(fā)源“Source”、觸發(fā)電平“Level”、角蟲發(fā)極性“Slope”、輸入信號“Waveform1 h”不口“Wayˉeform2 In”以及輸入信號“Waveform1 Out”不日"Waveform2 Out”。


  圖1 觸發(fā)器子vl的前面板

  程序功能主要通過程序框圖來實現(xiàn)。具體的程序框圖如圖2所示。圖中的主要功能是通過觸發(fā)源選擇開關(guān)“Source”對分支選擇結(jié)構(gòu)進行分支選擇。如果觸發(fā)源是通道B觸發(fā)即內(nèi)觸發(fā)時,那么輸入的信號經(jīng)過SLOPE.Ⅵ產(chǎn)生信號的序號index。輸入分支選擇塊的兩路通道的信號通過“數(shù)據(jù)子集”函數(shù)返回從index開始的長度為1 000的一段信號,并將這一段信號作為輸出信號通過觸發(fā)器子Ⅵ輸出。如果觸發(fā)源是通過外觸發(fā)(EXT)產(chǎn)生,那么此時直接將輸入觸發(fā)器子Ⅵ的兩路信號作為輸出信號輸出。


  圖2 觸發(fā)器子Ⅵ的程序框圖

  在此程序框圖中,用到“數(shù)據(jù)子集”函數(shù),該函數(shù)的主要功能是從輸入數(shù)組中返回從index開始的長度為length的一段數(shù)組。

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鎖存允許端(LE)的作用。當LE為高電平時,輸出端(Q0至Q7)隨輸入數(shù)據(jù)端(D0至D7)的變化而變化。當LE為低電平時,輸出端被鎖存在已建立的數(shù)據(jù)電平,即使輸入數(shù)據(jù)端發(fā)生變化,輸出端的電平也不會改變。

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74LS175是一款4D觸發(fā)器集成電路,它包含6個D觸發(fā)器,這些觸發(fā)器可以組合起來形成寄存器或搶答器等多種功能部件。

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對電路的復(fù)位往往是指對觸發(fā)器的復(fù)位,也就是說電路的復(fù)位中的這個“電路”,往往是指觸發(fā)器,這是需要注意的。

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觸發(fā)器是數(shù)字邏輯電路中的基本元件,用于存儲二進制狀態(tài)。RS觸發(fā)器是最早的觸發(fā)器類型之一,由兩個與門和一個或門構(gòu)成?;綬S觸發(fā)器具有置位、復(fù)位和保持功能,其特性方程是描述觸發(fā)器輸入與輸出之間邏輯關(guān)系的數(shù)學(xué)表達式。

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當觸發(fā)器的兩個輸入端加入不同邏輯電平時,它的兩個輸出端Q和Q有兩種互補的穩(wěn)定狀態(tài)。一般規(guī)定觸發(fā)器Q端的狀態(tài)作為觸發(fā)器的狀態(tài)。

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本文中,小編將對觸發(fā)器予以介紹,如果你想對觸發(fā)器的詳細情況有所認識,或者想要增進對它的了解程度,不妨請看以下內(nèi)容哦。

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