FPGA
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小型化低功耗數(shù)字信號處理器設計
摘要：隨著電子技術的不斷進步，一些原本只能安裝在較大平臺的通信設備通過小型化、低功耗設計已經(jīng)能夠加裝在較小的平臺上，而通信設備的加裝會使這些平臺的信息化程度大幅提升，從而適應更多的應用場合。為了實現(xiàn)通信設備的小型化和低功耗，文章給出了通信信號處理器的小型化和低功耗設計方法。
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Achronix和Signoff半導體攜手為人工智能/機器學習應用提供FPGA和eFPGA IP設計服務
雙方的合作將加快基于Speedster7t FPGA和Speedcore eFPGA IP的解決方案的開發(fā)
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8-2、DSP和FPGA的優(yōu)缺點分析
本課件來自專欄課程：《視頻課程|雷達反干擾設計》，需要查看視頻講解，并且下載本文課件、程序、和參考資料的請到文末查看詳情。每周更新一節(jié)視頻課，每課約50分鐘。本課程有專屬的微信交流群，訂閱專欄后即可聯(lián)系小編（Zang_lxl）邀請加入，和更多的同學們一起交流學習，并不定時有相關資...
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基于FPGA和DSP的1394b雙向數(shù)據(jù)傳輸系統(tǒng)
摘要:IEEE1394串行總線以其高速實時性的特點和靈活可配置的拓撲結(jié)構為提高系統(tǒng)，性能提供了一種有效的途徑。文中介紹了IEEEStd1394b總線系統(tǒng)的功能和特點，并以FPGA和DSP為控制核心設計了1394b雙向數(shù)據(jù)總線傳輸系統(tǒng)，最后闡述了系統(tǒng)的硬件設計、工作流程以及總線的配置過程。
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Microchip發(fā)布智能高級合成(HLS)工具套件，助力客戶使用PolarFire? FPGA平臺進行基于C++的算法開發(fā)
新工具套件增強了PolarFire FPGA在邊緣計算系統(tǒng)中進行硬件加速的用途
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基于FPGA的生命探測儀算法研究與系統(tǒng)設計
摘要：給出了一種基于FPGA的生命探測信號處理系統(tǒng)的設計方法。從理論上研究了生命探測儀的算法及其軟硬件系統(tǒng)。其中在FPGA軟件設計中利用模塊化的思想方法分別設計了FIR濾波器、異步FIFO、UART、電池監(jiān)控、功能控制等功能模塊。最后完成人體特征信號和體動信號的分析與提取，實現(xiàn)了非接觸情況下生命探測與發(fā)現(xiàn)。相對于傳統(tǒng)的生命探測儀，該設備具有體積小，功耗低，操作簡單，攜帶方便等優(yōu)點，特別適用于野外和戰(zhàn)場生命探測等應用場合。
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基于NANDFLASH的大容量視頻存儲系統(tǒng)的設計
摘要：針對MPEG4格式壓縮的視頻數(shù)據(jù)，給出了采用NANDFLASH為存儲介質(zhì)，以FPGA為存儲陣列的控制器，并用DSP作為數(shù)據(jù)處理的核心單元，來完成大容量視頻數(shù)據(jù)存儲的系統(tǒng)設計方法，同時對壞塊的檢測處理等關鍵問題提出了解決方案。
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一種基于FPGA的全數(shù)字鎖相環(huán)設計
摘要：給出了使用verilogHDL語言對鎖相環(huán)進行基于FPGA的全數(shù)字系統(tǒng)設計，以及對其性能進行分析和計算機仿真的具體方法。該方法采用綜合仿真工具QuartusU8.0來對數(shù)字鎖相環(huán)進行輸入設計、功能時序仿真及器件編程。仿真結(jié)果表明：該方法可通過在傳統(tǒng)數(shù)字鎖相環(huán)基本結(jié)構的基礎上增加自動變模控制模塊來有效解決縮短捕捉時間和減小同步誤差之間的矛盾。
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基于SoCFPGA異步通信接口的實現(xiàn)
摘 要：針對Altera SoC FPGA平臺的Linux環(huán)境下ARM核與FPGA邏輯之間的數(shù)據(jù)交換問題，提出了一種簡單有效的異步接口實現(xiàn)方案。該方案在輕量級總線橋上掛載Avalon 三態(tài)控制器，并通過Linux應用程序讀寫控制器對應的地址，從而實現(xiàn)ARM核與FPGA邏輯間數(shù)據(jù)的異步交換。實驗結(jié)果表明，該方案能夠穩(wěn)定、正確、快速地讀寫數(shù)據(jù)，可達到預期目標。
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FPGA的Veilog HDL語法、框架總結(jié)
摘要：VerilogHDL硬件描述語言是在用途最廣泛的C語言的基礎上發(fā)展起來的一種硬件描述語言，具有靈活性高、易學易用等特點。VerilogHDL可以在較短的時間內(nèi)學習和掌握，F(xiàn)PGA的VeilogHDL基礎語法總結(jié)，看完這些，F(xiàn)PGA的基本語法應該就沒啥問題了！一、基礎知識1、...
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專欄?.?基于FPGA的雷達信號處理實現(xiàn)
這是一個視頻課程，每個目錄序號包含3節(jié)課程，共10*3=30節(jié)視頻課程，平均每節(jié)課40多分鐘。目前已經(jīng)全部更新完成，適合你對雷達基礎知識的軟硬件進行一個較為系統(tǒng)的學習。本課程前期是基礎理論的講解，后期是結(jié)合經(jīng)驗和項目實踐提煉的主要內(nèi)容，圍繞抗干擾和工程實現(xiàn)進行原理闡述，省去了復雜...
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專欄 . 基于FPGA的雷達信號處理實現(xiàn)
這是一個視頻課程，每個目錄序號包含3節(jié)課程，共10*3=30節(jié)視頻課程，平均每節(jié)課40多分鐘。目前已經(jīng)全部更新完成，適合你對雷達基礎知識的軟硬件進行一個較為系統(tǒng)的學習。本課程前期是基礎理論的講解，后期是結(jié)合經(jīng)驗和項目實踐提煉的主要內(nèi)容，圍繞抗干擾和工程實現(xiàn)進行原理闡述，省去了復雜...
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幾組實用FPGA原理設計圖
FPGA（Field－ProgrammableGateArray），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的...
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單片機，ARM，F(xiàn)PGA，嵌入式這些有什么區(qū)別
學習嵌入式需要了解硬件知識，其中包括單片機、ARM、FPGA等，不同的硬件有不同的特點，需要了解他們相應的特點才有利于操作應用。那么單片機、ARM、FPGA、嵌入式的區(qū)別和特點有哪些呢？單片機1、受集成度限制，片內(nèi)存儲器容量較小，一般內(nèi)ROM：8KB以下；2、內(nèi)RAM：256KB...
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基于ADC08D500的FPGA數(shù)據(jù)采集系統(tǒng)
摘要：為了解決軟件無線電應用中高頻處理信號的大帶寬信號采集和處理問題，給出了一種在FPGA數(shù)據(jù)采集系統(tǒng)中采用高速A/D轉(zhuǎn)換芯片ADC08D500來對寬帶、高頻信號進行實時采樣和轉(zhuǎn)換的設計方案以及實驗結(jié)果，該方案采用模塊化設計，設計簡單，通用性強，可用于高速系統(tǒng)中的實時數(shù)據(jù)采集和處理。
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小鳥科技借助Xilinx Kintex? FPGA打造高性價比4K60無損分布式解決方案-final
賽靈思FPGA平臺出色的性能和簡潔易用的 Vivado?開發(fā)工具，助力小鳥科技將業(yè)界領先的專業(yè)音視頻解決方案性能提升1.5倍，并提前半年推向市場
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FPGA 與 GPU 計算存儲加速對比：單位功耗性能考量因素
為了提升計算基礎設施的性能，并緊跟數(shù)據(jù)分析與 AI 不斷攀升的需求，眾多企業(yè)將硬件加速視為主要的解決方案。在大多數(shù)情況下，先進的可編程硬件是加速的主要方式。
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Microchip推出新型中等帶寬FPGA器件，實現(xiàn)邊緣計算系統(tǒng)功率和性能的飛躍
Microchip全新低密度PolarFireò器件靜態(tài)功耗是同類器件的一半，同時提供全球最小的發(fā)熱區(qū)域
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基于NiosII的多串口轉(zhuǎn)發(fā)通信處理機設計
摘要：針對工業(yè)控制領域中對多串口通信的需求，采用SOPC技術并利用FPGA的可編程性，給出了一個基于NiosII的30路串口數(shù)據(jù)轉(zhuǎn)發(fā)通信處理機的設計方法，同時定義了相應的數(shù)據(jù)通信協(xié)議，從而實現(xiàn)了30路下位機與上位機的串口通信。實驗結(jié)果表明，該系統(tǒng)具有相對較高的可靠性和穩(wěn)定性，并可以根據(jù)實際需求靈活改變串口個數(shù)，具有良好的可移植性、易實現(xiàn)性和靈活性。
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基于MCU+FPGA的CCB測試盒實現(xiàn)方法
摘要：介紹了石油測井行業(yè)的三總線接口和雙相碼接口原理，給出了采用C8051F500處理器和FPGA來設計 CCB測試盒的實現(xiàn)方法，該CCB測試盒以MCU為核心，并通過FPGA來進行邏輯控制通信的編解碼。因而人機界 面友好，成本低，升級更新方便，并具有很大的靈活性。
