當拉/灌電流數(shù)模轉(zhuǎn)換器(IDAC)驅(qū)動負載時,通道電源電壓(PVDD)和輸出負載電壓的差值會以電壓降的形式作用于負載上。這會導(dǎo)致片內(nèi)功耗,進而造成芯片溫度過高,不僅影響可靠性,還可能降低系統(tǒng)整體效率。為了解決上述問題,本文介紹了一種簡易的動態(tài)功率控制方法。同時,通過采用集成ADI公司最新單電感多輸出(SIMO)技術(shù)的DC-DC轉(zhuǎn)換器,還有助于縮小解決方案尺寸。借助動態(tài)功率控制,IDAC電源電壓維持在極低水平,確保IDAC通道在任何給定輸出電流和負載電壓下都能正常運行,從而盡量降低片內(nèi)功耗。
傳統(tǒng)上,開關(guān)模式電源(SMPS)噪聲較高,無法直接用于噪聲敏感型模數(shù)轉(zhuǎn)換器(ADC),因此需要額外的低壓差(LDO)穩(wěn)壓器來供電。近年來,SMPS技術(shù)取得了顯著進展,特別是Silent Switcher?架構(gòu)和電磁干擾(EMI)噪聲屏蔽技術(shù)的應(yīng)用,有效降低了EMI輻射和輸出紋波電壓。得益于此,我們可以將采用噪聲抑制技術(shù)的單一SMPS器件置于噪聲敏感型器件附近,而不會影響ADC的信噪比(SNR)。本文將詳細探討這項技術(shù)。
不同于采用單個晶體管的Clapp、Colpitts和Hartley振蕩器,Peltz配置使用兩個晶體管。觀察圖1,注意晶體管Q1配置為共基極放大器級。由L1和C1組成的諧振電路提供集電極負載。集電極的輸出饋送到晶體管Q2的基極。Q2配置為射極跟隨器(共集電極)級。當射極跟隨器(Q2發(fā)射極)的輸出連接回Q1發(fā)射極處的共基極級輸入時,形成振蕩所需的正反饋。共基極放大器級的電壓增益在LC諧振電路的并聯(lián)諧振頻率處達到最大值,此時其阻抗接近無窮大。射極跟隨器的增益總是略小于1。環(huán)路周圍的組合增益在諧振時將遠大于1,以維持振蕩。
傳統(tǒng)上,開關(guān)模式電源(SMPS)噪聲較高,無法直接用于噪聲敏感型模數(shù)轉(zhuǎn)換器(ADC),因此需要額外的低壓差(LDO)穩(wěn)壓器來供電。近年來,SMPS技術(shù)取得了顯著進展,特別是Silent Switcher?架構(gòu)和電磁干擾(EMI)噪聲屏蔽技術(shù)的應(yīng)用,有效降低了EMI輻射和輸出紋波電壓。得益于此,我們可以將采用噪聲抑制技術(shù)的單一SMPS器件置于噪聲敏感型器件附近,而不會影響ADC的信噪比(SNR)。本文將詳細探討這項技術(shù)。
隨著嵌入式系統(tǒng)日益復(fù)雜,傳統(tǒng)微控制器往往難以滿足當今的性能需求。于是,設(shè)計人員紛紛開始采用片上系統(tǒng)(SoC)解決方案。這類方案雖能提供更高的集成度和處理能力,卻也帶來了新的挑戰(zhàn),尤其是在電源管理方面。本文將探討為SoC供電的基本考量因素,重點講解如何解讀和運用數(shù)據(jù)手冊及技術(shù)參考手冊中的關(guān)鍵信息。通過剖析影響電源方案設(shè)計的五個關(guān)鍵條件,本文將提供一份切實可行的分步指南,助力工程師胸有成竹地將電源管理集成電路(PMIC)集成到基于SoC的系統(tǒng)中。
任何開關(guān)電源都無法提供絕對精確的輸出。輸出電壓的調(diào)節(jié)精度會受到多種容差的影響。本文解釋了各種不精確性的來源,并說明了如何確定總?cè)莶罘秶?/p>
中國北京,2025年10月15日——全球領(lǐng)先的半導(dǎo)體公司Analog Devices, Inc. (Nasdaq: ADI)宣布推出綜合性產(chǎn)品系列ADI Power Studio,可實現(xiàn)先進的建模、元件推薦、效率分析與仿真功能。此外,ADI還發(fā)布了Power Studio產(chǎn)品系列中具備現(xiàn)代化用戶體驗的兩款網(wǎng)頁端新工具(ADI Power Studio Planner和ADI Power Studio Designer)的早期版本。這兩款新工具與ADI Power Studio全套產(chǎn)品系列(包括LTspice?、SIMPLIS?、LTpowerCAD?、LTpowerPlanner?、EE-Sim?、LTpowerPlay?和LTpowerAnalyzer?)相結(jié)合,能夠有效簡化整個電源系統(tǒng)設(shè)計流程。
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